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Aula virtual - 86.41 / 66.17 - Sistemas Digitales
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Trabajos prácticos (Práctica de los jueves)
Trabajos Prácticos
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Trabajos Prácticos
Material para la realización de los trabajos prácticos sobre lógica programable de las
FPGA
2. Trabajo Práctico 2
2.2. Diapositivas de los Procesos de Elaboración y Síntesis
https://campusgrado.fi.uba.ar/pluginfile.php/47722/mod_book/chapter/386/ElaboracionYSintesis.pdf
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Presentación de la materia
Presentación VHDL
Contador de N bits Lento
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FPGA
Multiplicación
Sigma-Delta
CORDIC
Punto Fijo - Punto Flotante
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Picoblaze / MicroBlaze
Ejemplo de encendido de led usando PicoBlaze
PicoBlaze (KCPSM3)
Introducción a Vivado
Presentacion Aceleracion por Hardware (Video)
Diapositivas (PDF)
Presentación Curso Básico de Verilog (Video)
Diapositivas (PDF)
Codigo Fuente
Práctica 1 - VHDL
Práctica 2 - VHDL avanzado
Práctiva 3 - Circuitos Aritméticos
Práctica 4
Práctica 5
Videos de las practicas
Trabajo Práctico 1
Trabajo Práctico 2
Trabajo Práctico 2 - Archivos de prueba
Trabajo Práctico 3
Trabajos Prácticos de Sistemas Embebidos sobre FPGA
Dispositivos UART de las placas remotas
Trabajo práctico final (versión A)
Archivo de coordenadas
Archivo de coordenadas (copia)
Trabajo práctico final (versión B)
Trabajo práctico final (versión C)
Spartan-3 FPGA Family Data Sheet
Starter Kit Board User Guide
XST User Guide
Vivado Design Suite User Guide: Synthesis
Nexys™2 Spartan-3E FPGA Board
A survey of CORDIC algorithms for FPGA based computers
Floating point paper
Sistema con MicroBlaze (Tutorial básico)
Tutorial Vivado instalación
Tutorial Vivado licenciamiento
ISE
Vivado
ModelSim Starter Edition - HDL Simulation
Adept
GHDL
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Tutorial Uso del VIO
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VGA
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Codigo
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KCPSM
Sistema base - Enecender leds
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Aplicación para depurar la unidad de suma de Punto Flotante
Fuentes de una UART (copia)
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Script para utilizar GHDL y GTKWave
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Banco de pruebas para el sumador de 1 bit
Flip-flop D
Banco de pruebas para el Flip-flop D
Sumador de N bits
Banco de pruebas para el sumador de N bits
Sumador de N bits (version 2)
Banco de pruebas para el sumador de N bits (version 2)
Generador de habilitación
Banco de pruebas para el generador de habilitación
Contador de N bits Modulo
Banco de pruebas para el contador de N bits Modulo
Código Sumador/Restador
Planilla de Simulacion del algoritmo Cordic
Planilla Sigma-Delta
Planilla Pantalla VGA
vhdl-style-guide
Paste of Code
"Computer Architecture A Quantitative Approach", Hennessy & Patterson
"VHDL: Analysis and Modeling of Digital Systems", Zainalabedin Navabi
"VHDL: Hardware description and design", Roger Lipsett, Carl Schaffer & Cary Ussery
"FPGA Prototyping by VHDL Examples: Xilinx Spartan-3 Version", Pong P. Chu
Novedades
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Trabajos Prácticos de Sistemas Embebidos sobre FPGA ►
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